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內容簡介

　　《高性能FPGA係統：時序設計與分析》全麵係統地討論瞭高性能FPCA時序設計、分析的基本原理與實現方法。全書共分7章：第1章以Xilinx FPGA為例，對FPCA的設計流程進行瞭概述；第2章對FPGA時序參數定義、流水綫與並行處理設計技術、時序路徑分類、時鍾的非理想性（時鍾偏斜與時鍾抖動）等進行瞭探討；第3章主要討論瞭FPCA時序約束設計要點，包括Xilinx FPCA時序約束語法規則、時序約束分組方法以及不同路徑的時序約束方法等；第4章介紹瞭FP-CA時序約束分析的原理和方法，主要包括周期約束分析、偏移約束分析、時鍾偏斜和時鍾不確定性分析，此外還介紹瞭時序分析器Timing Analyzer的基本使用方法；第5章介紹瞭FPGA時序收斂的流程，分析瞭代碼風格以及邏輯綜閤優化對時序收斂的影響，指齣瞭有助於提高FPGA性能的設計方法；第6章和第7章分彆以XilinxSpartan-3與Virtex-5/6係列FPCA為例，對麵嚮時序性能的FPCA邏輯綜閤技術進行瞭深入的探討。全書條理清晰，內容先進，講解透徹，便於自學。
　　《高性能FPGA係統：時序設計與分析》可作為信息與通信工程、電子科學與技術、計算機科學與技術、控製科學與工程或相關專業的高年級本科生和研究生的教材，同時也是從事FPGA技術研究與微電子技術研究、生産及應用的工程技術人員的重要參考書。另外，對於其他專業想瞭解高性能FPGA時序設計與分析的工程技術人員，也是一本很有價值的參考書。

內頁插圖

目錄

第1章 FPGA設計流程概述
1.1 FPGA設計流程
1.1.1 需求定義階段
1.1.2 結構設計階段
1.1.3 實現階段
1.1.4 驗證階段
1.2 基於FPGA的SoPC設計方法
1.2.1 基於FPGA的典型SoPC開發流程
1.2.2 SoPC的開發環境

第2章 FPGA時序參數與時序路徑
2.1 時序參數定義與分析
2.1.1 時序電路的基本單元
2.1.2 時序電路的時間參數
2.1.3 同步設計
2.1.4 時鍾設計
2.1.5 毛刺消除
2.1.6 穩態和亞穩態
2.1.7 流水綫與並行處理
2.1.8 路徑與路徑延遲
2.2 時鍾偏斜的概念及影響
2.2.1 負時鍾偏斜
2.2.2 正時鍾偏斜
2.2.3 采用時鍾分布技術降低時鍾偏斜
2.2.4 時鍾偏斜的時序分析
2.3 時鍾抖動的概念及影響
2.3.1 時鍾抖動的概念與産生機理
2.3.2 時鍾抖動與相位噪聲
2.3.3 時鍾抖動對模數轉換器性能的影響
2.3.4 降低時鍾抖動的方法
2.4 時序路徑的分類
2.4.1 Clock-to-Setup路徑
2.4.2 Clock-to-Pad路徑
2.4.3 Clock Input路徑
2.4.4 Pad-to-Setup路徑
2.4.5 Setup-to-Clock-at-the-Pad路徑
2.4.6 Clock-Pad-to-Output-Pad路徑
2.4.7 Pad-to-Pad路徑

第3章 FPGA時序約束設計
3.1 時序約束前的設計要點
3.1.1 理解目標器件的結構和資源
3.1.2 理解目標器件的時鍾資源
3.1.3 準確定義性能要求
3.1.4 正確使用綜閤工具及其控製屬性
3.1.5 正確使用實現工具及其控製屬性
3.1.6 評估關鍵路徑
3.1.7 使用Smart Guide保存設計結果
3.2 時序約束語法規則
3.2.1 FROM-THRU-TO約束
3.2.2 PERIOD約束
3.2.3 TIMESPEC約束
3.2.4 TNM約束
3.2.5 TNM_NET約束
3.2.6 TPSYNC約束
3.2.7 TPTHRU約束
3.2.8 TSidentifier約束
3.2.9 0FFSETIN約束
3.2.10 0FFSETOUT約束
3.2.11 TIG約束
3.3 時序約束分組
3.3.1 分組約束
3.3.2 使用TNM/TNM_NET屬性建立用戶定義時序分組
3.3.3 約束優先級
3.4 時序約束方法
3.4.1 輸入路徑時序約束方法
3.4.2 寄存器到寄存器的時序約束方法
3.4.3 輸齣路徑時序約束方法
3.4.4 時序例外
3.4.5 DLL/DCM/PLL/BUFR/PMCD元件的時序約束

第4章 FPGA時序約束分析
4.1 時序約束分析概述
4.2 PERIOD約束時序分析
4.2.1 PERIOD約束時序分析概述
4.2.2 PERIOD約束時序分析
4.3 FROM:TO約束時序分析
4.3.1 FROM:TO約束時序分析概述
4.3.2 FROM：TO約束時序分析規範
4.4 0FFSET約束時序分析
4.4.1 0FFSET約束時序分析概述
4.4.2 0FFSETIN約束時序分析
4.4.3 0FFSETOUT約束時序分析
4.5 時鍾偏斜分析
4.6 時鍾不確定度分析
4.7 改善性能的時序約束設計方法
4.8 利用時序分析器分析時序約束
4.8.1 Timing Analyzer概述
4.8.2 輸入偏移約束時序分析
4.8.3 創建和瀏覽時序分析報告
4.8.4 同步元件時序分析
4.8.5 輸齣時序分析
4.8.6 時序例外約束分析
4.8.7 不受約束路徑分析
4.8.8 交叉探查分析
……
第5章 FPGA時序收斂流程
第6章 麵嚮時序性能的Spartan -3FPGA綜閤技術
第7章 麵嚮時序性能的Virtex - 5/6FPGA綜閤技術
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書印刷質量不錯，內容有些抽象，主要是數字電路、數字邏輯工程實現的經驗和總結，適閤有一定工程經驗的人員閱讀和學習

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很少有這類專業的書，支持一下！如果有altera版的就更好瞭！

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看不太明白

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書印刷質量不錯，內容有些抽象，主要是數字電路、數字邏輯工程實現的經驗和總結，適閤有一定工程經驗的人員閱讀和學習

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主要講ISE的時序約束。要是能以sdc錶達約束就好瞭

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不錯，書很好

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不錯，專業必備，對於FPGA時序設計是一本和很實用的書，需要多讀，多練習纔能熟練。

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印刷質量一般內容還行

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不錯很少有講時序約束這麼好的書。而時序約束對FPGA技術來講其實非常重要。

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