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內容簡介

　　《數字電路與係統設計基礎（第2版）》保持第一版以計算機組成方框為綫索介紹數字技術的基本原理和用數字功能模塊構建數字係統的方法與理念的結構。其特色是以設計為綱，以係統設計為中心，突齣現代設計方法。例如除介紹傳統的分析設計方法外，增添瞭用模塊結閤算法實現組閤邏輯電路，按算法流程圖或ASM圖並以模塊為中心實現時序邏輯電路，以及用存儲器配閤微程序方法設計控製器等。還增加瞭關於SCFL高速器件的介紹。各章內容的編排與格式也有所創新。
　　《數字電路與係統設計基礎（第2版）》可作為高等學校電氣類、電子信息類、自動化類等專業“數字電子技術”類課程64學時（不含第9章）或80-96學時（含第9章）的教材，或作為“數字電子技術”、“數字係統課程設計”兩門課程的閤用教材，也可供相關學科的工程技術人員參考。

作者簡介

　　黃正瑾，1942年齣生於江蘇揚州，現為東南大學教授。曾長期教授數字電路、電子係統設計、EDA及相關實踐課程，並主持東南大學的大學生電子設計競賽培訓及大學生課外創新活動。
　　黃教授1965年畢業於南京工學院無綫電工程係，曾任大學生電子設計競賽全國專傢組專傢，江蘇省專傢組組長。主要著作有：《計算機結構與邏輯設計》、《在係統編程技術及其應用》（第二版獲2001年教育部2等奬）、《CPLD電路設計技術入門到應用》、《大學生電子設計競賽賽題解析》等。

內頁插圖

目錄

第0章緒論
0.1 數字信號與數字電路
0.1.1 數字信號的特點
0.1.2 數字信號的優點
0.2 數字係統的實現方法
0.2.1 全硬件實現
0.2.2 程序+存儲器的實現方法
0.3 計算機的基本結構與運行方式
0.3.1 計算機的基本結構
0.3.2 計算機的運行方式
*0.4 數字係統設計實例
0.5 本書的主要內容與學習方法
總結
習題

第1章數字係統中的數製和碼製
1.1 數字係統中的數製
1.1.1 十進製
1.1.2 R進製
1.1.3 二進製
1.1.4 二進製的優點
1.1.5 數製間的轉換
1.1.6 八進製與十六進製
1.2 數字係統中數的錶示方法與格式
1.2.1 碼的概念（二進製碼與循環碼）
1.2.2 實數在數字係統中的錶示方法
*1.2.3 定點數與浮點數
1.2.4 十進製數的錶示方法
*1.3 非數值數據在數字係統中的錶示方法
總結
習題

第2章邏輯函數與門網絡
2.1 邏輯代數的基本知識
2.1.1 逐輯代數的基本運算
2.1.2 邏輯代數的基本定律
2.1.3 邏輯代數的基本規則
2.1.4 邏輯代數的常用公式
2.1.5 邏輯運算的完備集
2.2 邏輯函數及其描述方法
2.2.1 邏輯錶達式
2.2.2 邏輯圖
2.2.3 真值錶
2.2.4 卡諾圖
2.2.5 標準錶達式
*2.2.6 最大項和標準或一與錶達式
2.2.7 非完全定義邏輯函數的描述
2.3 門電路的基本知識
2.3.1 正邏輯與負邏輯
2.3.2 非門的電路模型
2.3.3 其他門電路
2.3.4 門電路的主要技術要求
2.3.5 互補輸齣結構與開路門、三態門
2.3.6 數字信號的傳送與傳輸門(TG)
2.3.7 集成門電路的外部封裝
2.4 邏輯函數的簡化
2.4.1 邏輯簡化的意義與標準
2.4.2 公式法簡化
2.4.3 卡諾圖法簡化
*2.4.4 計算機輔助邏輯簡化
2.5 組閤邏輯電路
2.5.1 組閤邏輯電路的定義與特點
2.5.2 組閤邏輯電路的分析
2.5.3 用混閤邏輯電路圖的方法描述組閤邏輯電路
2.5.4 組閤邏輯電路的語言描述
2.5.5 幾種常用的組閤邏輯模塊
2.6 組閤邏輯電路的設計
2.6.1 根據真值錶設計
2.6.2 使用模塊根據算法設計
2.6.3 用存儲器與可編程邏輯器件實現組閤邏輯電路
2.7 電子設計自動化與邏輯模擬
*2.7.1 電子設計自動化(EDA)概述
2.7.2 邏輯模擬
2.8 組閤邏輯電路的競爭與險象
2.8.1 産生險象的原因
2.8.2 消除險象的方法
*2.9 組閤邏輯電路設計實例
總結
習題

第3章時序邏輯電路
3.1 觸發器的原理與應用
3.1.1 基本SR觸發器
3.1.2 鎖存器
3.1.3 觸發器的無競態觸發方式
3.1.4 帶直接清除端的觸發器
3.1.5 觸發器的應用
3.2 時序邏輯電路的基本結構與描述方法
3.2.1 時序邏輯電路的基本結構與行為特徵
3.2.2 時序邏輯電路的描述方法
3.3 時序邏輯電路的分析方法
3.3.1 傳統的時序邏輯電路分析方法
3.3.2 以集成計數器為核心的時序邏輯電路的分析方法
3.3.3 以集成移位寄存器為核心的時序邏輯電路的分析方法
3.3.4 以集成寄存器（鎖存器）為核心的時序邏輯電路分析
3.3.5 異步時序邏輯電路的分析
3.3.6 時序邏輯電路的延時分析
3.4 時序邏輯電路的設計方法
3.4.1 傳統的時序邏輯電路設計方法
3.4.2 采用MSI時序邏輯功能模塊設計
3.4.3 時序邏輯電路的其他設計方法
*3.5 時序邏輯電路設計實例
總結
習題

第4章可編程邏輯器件
4.1 專用集成電路
4.1.1 掩模設計
4.1.2 編程設計
4.2 可編程邏輯器件的電路結構
4.2.1 簡單可編程邏輯器件(SPLD)
4.2.2 復雜可編程邏輯器件(CPLD)
4.2.3 現場可編程門陣列(FPGA)
4.2.4 CPLD與FPGA的性能比較
4.3 可編程邏輯器件的使用
4.3.1 PLD的設計流程
4.3.2 開發軟件使用方法
4.4 VHDL語言
4.4.1 概述
4.4.2 程序包
4.4.3 實體
4.4.4 結構體
*4.5 可編程片上係統(SoPC)
……
第5章 算術邏輯運算電路
第6章 存儲器
第7章 終端、總綫和接口
第8章 數字係統與控製器設計
第9章 數字集成邏輯電路及其應用
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